Les Programmable Logic Controllers (PLC) sont des dispositifs numériques industriels utilisés pour contrôler les processus de fabrication automatisés, tels que les lignes d’assemblage ou les robots de toute sorte. Le langage Ladder, également connu sous le nom de Ladder Logic, est un langage de programmation utilisé pour développer des logiciels pour PLC. Du fait de leur utilisation très répandue dans l’industrie, vérifier que les programmes Ladder sont conformes à leur comportement attendu est d’une importance cruciale. Dans ce travail, nous considérons une description du comportement attendu sous la forme d’un timing chart, décrivant les scénarios d’exécution. Notre approche consiste à traduire le code Ladder et le timing chart en un programme pour l’environnement Why3 dédié à la vérification déductive des programmes. La vérification se déroule en générant des conditions formelles de vérification, qui sont des énoncés mathématiques destinés à être prouvés valides à l’aide de prouveurs automatiques de théorèmes. Le but ultime est double : premièrement, en obtenant une preuve complète, nous pouvons vérifier la conformité du code Ladder par rapport au timing chart avec un degré élevé de confiance. Deuxièmement, lorsque la preuve n’est pas entièrement complétée, nous obtenons un contre-exemple, illustrant un scénario d’exécution possible du code Ladder qui n’est pas conforme au timing chart.